Extensión de interrupción rápida para MCU RISC-V

Investigadores de ETH Zurich y la Universidad de Bolonia publicaron un artículo técnico titulado “CV32RT: Habilitación de interrupción rápida y cambio de contexto para microcontroladores RISC-V”.

Abstracto:

“Los procesadores que utilizan RISC-V ISA abierto están encontrando una adopción cada vez mayor en el mundo integrado. Muchos casos de uso integrados tienen limitaciones en tiempo real y requieren un manejo reactivo flexible, predecible y rápido de los eventos entrantes. Sin embargo, los procesadores RISC-V todavía están rezagados en esta área en comparación con arquitecturas propietarias más maduras, como ARM Cortex-M y TriCore, que han sido optimizadas durante años. El controlador de interrupciones predeterminado estandarizado por RISC-V, el Core Local Switch (CLINT), carece de capacidad de configuración en la priorización y preferencia de interrupciones. La especificación del controlador de interrupción local (CLIC) central de RISC-V aborda esta preocupación al permitir interrupciones vectoriales preventivas y de baja latencia, al mismo tiempo que prevé extensiones opcionales para mejorar la latencia de las interrupciones. En este trabajo, implementamos un CLIC para el CV32E40P, un núcleo RISC-V de clase MCU de 32 bits de código abierto con soporte industrial, y lo mejoramos con fastirq: una extensión personalizada que proporciona una latencia de interrupción tan baja como 6 ciclos. Llamamos CV32RT nuestro núcleo mejorado. Hasta donde sabemos, CV32RT es el primer núcleo RV32 de código abierto con características competitivas de manejo de interrupciones en comparación con la serie Arm Cortex-M y TriCore. También se ha demostrado que las extensiones propuestas mejoran el cambio de contexto de tareas en sistemas operativos en tiempo real”.

Encuentra el documento técnico aquí. Publicado en noviembre de 2023.

Robert Balas, Alessandro Ottaviano y Luca Benini. “CV32RT: Habilitación de interrupciones rápidas y cambios de contexto para microcontroladores RISC-V”. arXiv:2311.08320v1 (2023)

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